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Livro Impresso

Arquitetura de Computadores

  • ISBN:

    9788535291742

  • Edição: 6|2019
  • Editora: GEN LTC

John Hennessy

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440515
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Essa 6ª edição da obra foi completamente revisada de acordo com os novos desenvolvimentos em processadores e arquitetura de sistemas. Ela inclui um conjunto de arquitetura do conjunto de instruções RISC-V, um tipo de arquitetura moderna desenhada com base
  • Formato: Impresso
  • Páginas: 816
  • Publicação: 21/06/2019
  • Capa: Brochura
  • Peso: 0,12 kg
  • Dimensões: 21 x 27

Essa 6ª edição da obra foi completamente revisada de acordo com os novos desenvolvimentos em processadores e arquitetura de sistemas. Ela inclui um conjunto de arquitetura do conjunto de instruções RISC-V, um tipo de arquitetura moderna desenhada com base em um modelo aberto e desenvolvida por pesquisadores. RISC-V facilita o desenvolvimento de processadores sistema-em-um-chip customizado. Como exemplo o livro inclui um estudo de caso totalmente desenvolvido de arquitetura de uma rede neural, que é também uma novidade nessa 6ª edição. Os autores ainda incluíram as últimas novidades em tecnologias de memória, mais informações sobre segurança de computadores e um exemplo de computação em escala de armazém dando suporte a modernos sistemas de computação na nuvem. Cada capítulo segue um consistente modelo: explicação das ideias apresentadas; uma seção de "assuntos transversais", que apresenta como os conceitos abordados em um capítulo se conectam com aqueles apresentados em outros capítulos; uma seção "colocando tudo junto" que faz a conexão desses conceitos a partir de discussões sobre como eles são aplicados no mundo real; e exemplos detalhados de mal-entendidos e armadilhas de arquitetura mais comumente encontradas por desenvolvedores e arquitetos

1. Fundamentals of Quantitative Design and Analysis 2. Memory Hierarchy Design 3. Instruction-Level Parallelism and Its Exploitation (Replace MIPS instr with RISC-V throughout) 4. Data-Level Parallelism in Vector, SIMD, and GPU Architectures 5. Thread-Level Parallelism (Replace MIPS instr with RISC-V as needed) 6. Special-Purpose Processors for Neural Networks 7. Warehouse-Scale Computers to Exploit Request-Level and Data-Level Parallelism Appendix A - Instruction Set Principles (Move to online appendix; separate ARM V2-7 & V8; add RISC-V) Appendix B - Review of Memory Hierarchy Appendix C - Pipelining: Basic and Intermediate Concepts (Replace MIPS instr with RISC-V throughout) Appendix D - Storage Systems Appendix E - Embedded Systems Appendix F - Interconnection Networks Appendix G - Vector Processors in More Depth (add RISC-V vector extension description?) Appendix H - Hardware and Software for VLIW and EPIC (no change) Appendix I - Large-Scale Multiprocessors and Scientific Applications (no change) Appendix J - Computer Arithmetic (add topics being discussed for next version of IEEE FP standard: e.g., reproducibility?) Appendix K - Survey of Instruction Set Architectures (add ARM V8, Distinguished earlier ARMs, add RISC-V) Appendix L - Historical Perspectives and References

ACM named John L. Hennessy a recipient of the 2017 ACM A.M. Turing Award for pioneering a systematic, quantitative approach to the design and evaluation of computer architectures with enduring impact on the microprocessor industry. John L. Hennessy is a Professor of Electrical Engineering and Computer Science at Stanford University, where he has been a member of the faculty since 1977 and was, from 2000 to 2016, its tenth President. Prof. Hennessy is a Fellow of the IEEE and ACM; a member of the National Academy of Engineering, the National Academy of Science, and the American Philosophical Society; and a Fellow of the American Academy of Arts and Sciences. Among his many awards are the 2001 Eckert-Mauchly Award for his contributions to RISC technology, the 2001 Seymour Cray Computer Engineering Award, and the 2000 John von Neumann Award, which he shared with David Patterson. He has also received seven honorary doctorates.